Implementierung von Hochgeschwindigkeits-DDR3-Speichercontrollern in einem mittleren FPGA
Die Implementierung eines hohen DDR3-Speichercontrollers mit hoher Wirkungsgrade in einem FPGA ist eine gewaltige Aufgabe. Bis vor kurzem unterstützten nur wenige High-End-FPGAs die Bausteine, die für die zuverlässige Hochgeschwindigkeits-DDR3-Speichergeräte erforderlich sind. Es wird jedoch eine neue Generation von FPGAs mit mittlerer Reichweite entwickelt.
Dieses Weißbuch untersucht die Designherausforderungen und wie eine bestimmte FPGA -Familie, das Gitterp3, das DDR3 -Speicher -Controller -Design erleichtern kann.
Laden Sie diesen Whitepaper herunter, um mehr zu erfahren.
Weiterlesen
Mit dem Absenden dieses Formulars stimmen Sie zu Lattice Semiconductor Corporation Kontaktaufnahme mit Ihnen marketingbezogene E-Mails oder per Telefon. Sie können sich jederzeit abmelden. Lattice Semiconductor Corporation Webseiten u Mitteilungen unterliegen ihrer Datenschutzerklärung.
Indem Sie diese Ressource anfordern, stimmen Sie unseren Nutzungsbedingungen zu. Alle Daten sind geschützt durch unsere Datenschutzerklärung. Bei weiteren Fragen bitte mailen dataprotection@techpublishhub.com
Related Categories: Komponenten, Leistung
Weitere Ressourcen von Lattice Semiconductor Corporation
Eingebettete Signalverarbeitungsfunktionen de...
Neue Marktsegmente fördern zunehmend konkurrierende FPGA -Anbieter, um eine breitere Vielfalt an Funktionen und Flexibilität in ihre Geräte einz...
Die Auswirkungen von Energieeffizienzstandard...
Wenn strengere staatliche Vorschriften für den Stromverbrauch erscheinen, werden selbst traditionelle Haus- und Bürogeräte wie LCD -Fernseher, S...
Nutzung von FPGA- und CPLD -digitalen Logik, ...
Ein Analog -to Digital Converter (ADC) ist ein häufiger analoge Baustein und wird fast immer benötigt, wenn die digitale Logik wie in einer FPGA ...
